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Verstehen statt Staunen: Wie funktionieren Chips wirklich?

Wenn man Ingenieure bei TSMC oder ASML fragt, was die nächsten zehn Jahre bringen, bekommen sie einen leicht abwesenden Blick. Nicht weil sie nichts zu sagen hätten — sondern weil so vieles davon geheim ist. Prozessroadmaps sind Staatsgeheimnisse der Technologiebranche. Die Information, dass TSMC an 2-nm-Chips arbeitet, ist öffentlich. Die genauen Parameter dieser Chips sind es nicht.

Was wir sagen können, basiert auf veröffentlichten Roadmaps, Patentanmeldungen, wissenschaftlichen Publikationen — und auf dem Verständnis, dass die physikalischen Gesetze für alle gelten.

Kurzfristig (2–5 Jahre): Das Ende der klassischen Skalierung#

Die Industrie bewegt sich auf 2-nm-Prozesse zu — TSMC und Samsung haben beide angekündigt, erste 2-nm-Produktion ab 2025 hochzufahren. Diese Zahl ist jedoch irreführend: Die 2-nm-Zahl bezeichnet nicht mehr einen tatsächlich messbaren Transistordurchmesser, sondern ist ein Marketing-Bezeichner für einen bestimmten Leistungsfortschritt.

Entscheidender als die Zahl ist die neue Transistorarchitektur: Gate-All-Around (GAA). Beim klassischen FinFET-Transistor (der seit 2011 Standard ist) umschließt das Gate den Kanal auf drei Seiten. Beim GAA-Transistor — manchmal auch Nanosheet-Transistor genannt — umschließt das Gate den Kanal auf allen vier Seiten. Das gibt bessere Kontrolle, reduziert Leckströme, ermöglicht weitere Miniaturisierung.

Diese Änderung klingt klein. Sie ist es nicht. Die Einführung des GAA-Transistors erfordert massive Anpassungen in der Lithographie, dem Ätzprozess, der Materialwahl und den Designwerkzeugen.

Mittelfristig (5–15 Jahre): 3D-Integration und Chiplets#

Wenn es schwieriger wird, Transistoren auf einer Ebene zu verkleinern, kann man sie übereinander stapeln. Die Industrie nennt das 3D-Stacking.

Erste Formen davon existieren bereits: TSMC's SoIC-Technologie und Intels Foveros-Technologie ermöglichen es, verschiedene Chipschichten mit dichten Verbindungen übereinander zu stapeln — ähnlich wie Stockwerke in einem Gebäude. Speicherchips können direkt über Prozessorchips montiert werden, was Datentransfers erheblich beschleunigt.

Eng verwandt ist die Chiplet-Architektur: Statt einen großen, komplexen Chip herzustellen — der teurer und fehleranfälliger ist, je größer er wird — fertigt man mehrere spezialisierte kleinere Chips (Chiplets) und verbindet sie in einem gemeinsamen Paket. AMD hat diese Strategie mit seinem EPYC-Prozessor erfolgreich vorgeführt. Apples M-Serien-Chips gehen einen ähnlichen Weg.

Langfristig (15–30 Jahre): Was kommt nach Silizium?#

Silizium hat physikalische Grenzen. Transistoren können nicht kleiner werden als ein einzelnes Atom — und auf dem Weg dahin treten Quantentunneling-Effekte auf, die Transistoren unzuverlässig machen.

Die Forschungsgemeinschaft arbeitet an Alternativen:

Galliumnitrid (GaN) und Siliziumkarbid (SiC): Beide sind bereits kommerziell eingesetzt, aber noch nicht für Hochleistungsmikroprozessoren. Sie sind ideal für Leistungselektronik — Ladegeräte, Wechselrichter für Solaranlagen, Elektromotorantriebe.

Kohlenstoffnanoröhren (CNTs): Transistoren aus Kohlenstoffnanoröhren könnten schneller und energieeffizienter sein als Silizium. IBM hat 2019 erste CNT-Transistoren auf Chipniveau demonstriert. Kommerziell sind sie noch weit entfernt.

Neuromorphe Chips: Statt eines binären Rechners, der mit 0 und 1 arbeitet, imitieren neuromorphe Chips das Verhalten biologischer Neuronen. Sie sind energieeffizient für KI-Aufgaben, aber schwer zu programmieren und noch nicht breit kommerziell.

Quantencomputer: Sie verdienen eine eigene Erwähnung — aber auch eine Warnung: Quantencomputer ersetzen keine klassischen Chips. Sie ergänzen sie für spezifische Probleme (Kryptographie, Simulation von Molekülen). Kein Smartphone wird je einen Quantenprozessor haben.

Die geopolitische Trajektorie#

Die Chipindustrie wird in den nächsten Jahrzehnten konsolidiert oder fragmentiert — je nachdem, ob internationale Kooperation möglich bleibt.

Im Optimismus-Szenario: Die heutigen Investitionen in Europa und den USA bauen echte Alternativen zu TSMC auf. Die Konzentration des Risikos nimmt ab. Die Chip-Lieferkette wird resilienter.

Im Pessimismus-Szenario: Exportkontrollen, Technologieallianztrennungen und geopolitische Spannungen führen zu zwei parallelen Chip-Ökosystemen — einem westlichen und einem chinesischen. Beide weniger effizient als die heutige integrierte Welt. Insgesamt höhere Kosten, langsamerer Fortschritt.

Was wir mit einiger Sicherheit sagen können: Der Innovationsdruck wird nicht nachlassen. KI braucht immer mehr Rechenleistung. Klimasimulationen, autonomes Fahren, moderne Medizin — alle verlangen leistungsfähigere Chips. Die Nachfrage ist gesichert. Die Frage ist, wer liefert.

Nächste Lektion: Was, wenn...? — Drei Gedankenexperimente zu den größten „Was-wäre-wenn"-Fragen der Chipindustrie.

Lesezeit: ca. 9–10 Minuten

Lektion 9 — Wie geht es weiter?